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Layout di una funzione logica

Elettronica lineare e digitale: didattica ed applicazioni

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[1] Layout di una funzione logica

Messaggioda Foto UtentePatras » 5 apr 2018, 19:58

Ciao a tutti! Qualcuno riesce per favore ad aiutarmi? Ho qualche difficoltà a capire il circuito rappresentato da questo layout. Dovrei a partire da questo ricavare la funzione logica. La vista sembra dal top, sono in rosso quindi in teoria dei pMOS però le varie giunzioni non so se le ho capite bene.
Insomma a me viene in mente dal seguente layout:
DOMANDA electro.jpg


qualcosa del genere:


Però credo che sia sbagliato perché a livello di funzione logica non mi dice niente... sembrano delle nand open drain insomma, non credo sia così. Qualcuno ha idea di come sia il circuito?
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[2] Re: Layout di una funzione logica

Messaggioda Foto UtenteDrCox » 6 apr 2018, 10:11

Partiamo da sotto. Hai la connessione di GND che va su un contatto. Quelle alternanze verde/bianco saranno degli nMOS. Sopra, ben più grandi per compensare la diversa mobilità, hai i cugini pMOS.
Sotto hai dunque la serie di 4 nMOS.
Sopra puoi notare che da OUT vai, 4 volte, su un contatto che, tramite un pMOS, finisce a VDD.
Il risultato è il seguente:

"The past is not really the past until it has been registered. Or put another way, the past has no meaning or existence unless it exists as a record in the present."
John Archibald Wheeler
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[3] Re: Layout di una funzione logica

Messaggioda Foto UtentePatras » 6 apr 2018, 16:59

Grazie mille per la risposta, ora ci sono :ok:
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