Connecting to MPLAB PICkit 3...
Firmware Suite Version.....01.28.18
Firmware type..............dsPIC33F/24F/24H
Target detected
Device ID Revision = 3004
The following memory area(s) will be programmed:
program memory: start address = 0x0, end address = 0x3ff
configuration memory
Programming...
Programming/Verify complete
questo sul dspic33FJ128GP802 l'altro non ne vuole sapere ho un altro problema non lampeggia il led, ho dato un indirizzo alla LATA nel codice di Tardo e assegnato il nome nuovo del dspic mi date ancora una mano?
- Codice: Seleziona tutto
// Programma di base per il dsPIC33FJ128GP802.
// Scritto da TardoFreak
#include <p33FJ128GP802.h> //File di defines specifico per il dsPIC33FJ128GP804
// ------------ Fuses di configurazione della macchina ------------------------
// I fuses vengono settati UNA VOLTA SOLA all' interno del programma e al di
// fuori di funzioni o main.
// No Boot RAM, No Boot Segment, No Boot Write Protection
_FBS( RBS_NO_RAM & BSS_NO_BOOT_CODE & BWRP_WRPROTECT_OFF )
// No Secure Ram, No Flash Secure Segment, No Secure Write Protection
_FSS( RSS_NO_RAM & SSS_NO_FLASH & SWRP_WRPROTECT_OFF )
// Code protect off
_FGS( GSS_OFF & GCP_OFF & GWRP_OFF )
// Oscillatore primario con PLL, No switch fra oscillatori
_FOSCSEL( FNOSC_PRIPLL & IESO_OFF )
// No clock switching, No clock monitor, Oscillatore di tipo XT
_FOSC( FCKSM_CSDCMD & IOL1WAY_OFF & OSCIOFNC_OFF & POSCMD_XT )
// No watchdog timer
_FWDT( FWDTEN_OFF & WINDIS_OFF & WDTPRE_PR128 & WDTPOST_PS32768 )
// I2C mapped to SDA1/SCL1, Power On Timer 128ms
_FPOR( ALTI2C_OFF & FPWRT_PWR128)
// ------------------------ Main Program --------------------------------------
int main(void)
{
unsigned int c;
// Set frequenza di clock a 80 MHz.
// Di default, con un quarzo da 8 MHz, la frequenza di clock e' di 50 MHz
// Il VCO del PLL funziona a 200 MHz, ed il suo clock viene diviso per 4
// quindi bisogna prima abbassare la frequenza di ingresso (di default divisa
// per 2) dividendola per 4 ...
CLKDIVbits.PLLPRE = 2; // Divide per 4
// ... cambiare il divisore di feedback da 50 (default) a 80 ...
PLLFBDbits.PLLDIV = 78; // Divide per 80
// ... e cambiare il post divisore da 4 (default) a 2.
CLKDIVbits.PLLPOST = 0; // Divide per 2
// Inizializzazione porte
AD1PCFGL = 0xFFFF; // Disabilita gli ingressi analogici
TRISA = 0xFFFF; // PORTA come output
LATA = 0x0000;
// Programma di prova. Usa una variabile a 16 bit incrementata continuamente
// e presentata nella porta A.
c = 0;
while(1)
{
LATAbits.LATA0 = c;
c++;
}
return(0); // Questo "return" e' richiesto dal compilatore ma non serva a niente
}

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