Ho dei dubbi su di un esercizio di elettronica digitale.
L'esercizio è i il seguente:
Progettare un contatore che , a seconda del valore logico presente s tre segnali di ingresso S2S1S0 (con S2 il bit piu significativo, esegua un conteggio modilo N ,con N programmabile da 8 a 64.
La corrispondenza tra valore presente sugli ingressi S2S1S0 e N è la seguente N=8*(1+(S2S1S0))
Si sppone che il segnale di clock abbia frequenza 500kHz e che il ritardo di ciascun FF sia 50ns.

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