Accendere un LED con il Flip-Flop

[rusty]

La porta clock del 'HC175 NON e' triggerata, ovvero il circuito disegnato da simo85 devi realizzarlo cosi' come e' schematizzato, o usando un inverter triggerato o una nand triggerata tipo 'HC132, in altre parole e' un altro integrato che devi aggiungere, scegliendo ad esempio tra questi:

Inverter triggerato: 74HC14
Nand triggerata: 74HC132

Impari piu' leggendo i datasheet che ti linkiamo piuttosto che dalle riviste con schemi improbabili.

[ricello9]

La porta clock del 'HC175 NON e' triggerata, ovvero il circuito disegnato da simo85 devi realizzarlo cosi' come e' schematizzato, o usando un inverter triggerato o una nand triggerata tipo 'HC132.

Ok, adesso mi procuro un Inverter triggerato come mi hai suggerito e dopo aggiorno il circuito.

Grazie per l'aiuto.

[simo85]

Grazie per l'aiuto Simo85, volevo chiederti se quella porta logica che hai disegnato corrisponde ad un integrato esterno o rappresenta l'ingresso di clock del mio 74hc175?

La NAND ad isteresi rappresenta una porta logica esterna al integrato da te usato.

Il circuito interno di clock non è ad isteresi. Vedi schema interno del 74HC145 (datasheet linkato in 1):

cd.png (43.02 KiB) Osservato 6993 volte

e confrontalo con il circuito del 74HC74 (datasheet linkato in 6):

cd2.png (25.37 KiB) Osservato 6993 volte

Quest'ultimo è un ingresso ad isteresi.
Ciao.

[rusty]

In attesa del trigger, prova a fare questa prova veloce.
Stai attento alle connessioni, ti ho numerato i piedini del '175 cosi' non puoi sbagliare.

Sorgente FidoCadJ | Ingrandisci | Cos'è Fidocad

[PietroBaima]

Che ne dite di progettare la stessa macchina in sincrono?

Scelgo di progettare una macchina di Moore.
Diagramma a stati:

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In questo diagramma ho riportato in rosso lo stato e, subito dopo la barra, la relativa uscita, che andrà collegata al LED.
Lo stato del pulsante è stato indicato con P. P=0 significa "pulsante premuto".
Sono presenti due stati trappola, indicati con la scritta "TRAP STATE". Servono per fare in modo che, quando viene premuto il pulsante P, la macchina non si porti in uno stato stabile finché il tasto non viene rilasciato. Questo serve per fare in modo che, premendo il tasto, la macchina non commuti di continuo tra lo stato LED ACCESO/LED SPENTO ma si fermi finché il tasto non viene rilasciato.
Il "fulmine" con la scritta RESET indica lo stato nel quale viene forzata la macchina all'accensione.
Noterete che ho forzato la macchina a portarsi, all'accensione, in un TRAP STATE. Quando ci sono dei pulsanti conviene sempre forzare la macchina in un TRAP STATE, perché il condensatore che viene utilizzato per fare l'antirimbalzo dei pulsanti, all'accensione, risulta scarico, quindi la macchina è portata a credere che il pulsante sia premuto e, quindi, commuta l'uscita. Inoltre non è possibile fare previsioni sulla durata di questo evento perché non si otterrebbe un risultato affidabile. Meglio portare la macchina in un TRAP STATE che la condurrà, quando P verrà rilasciato, allo stato "LED SPENTO". Fino a che il condensatore è carico rimarrà nel TRAP STATE, dopodichè si porterà nello stato "LED SPENTO".
Il condensatore in questione fa parte del circuito antirimbalzo del pulsante, comunque necessario, perché, altrimenti, la macchina sarebbe portata a credere che l'utente stia premendo ripetutamente il pulsante e, quindi, farebbe più accensioni/spegnimenti con un singolo azionamento.
Per fare un circuito antirimbalzo completamente digitale sarebbe necessario inserire un contatore che conteggi un tempo di "blanking". Questa è la soluzione che viene solitamente impiegata quando si implementa la FSM su logica programmabile.
La numerazione scelta, per gli stati, è quella che minimizza la logica circuitale.
Facciamo quindi la mappa degli stati, ricavandola dal diagramma a stati:

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Le funzioni logiche per e sono quindi:




Per l'uscita Y (il LED) è possibile notare che


Scelgo di implementare la rete utilizzando solo porte NAND (e sceglierò un 74HCT132, in modo da poterle utilizzare anche per fare l'oscillatore e l'antirimbalzo per il tasto).

Riscrivo quindi le funzioni logiche in modo da usare solo NAND:





Per quanto riguarda il tasto P, dato che è disponibile un FF in più, dopo averlo ripulito dai rimbalzi, scelgo di renderlo sincrono, in modo da non avere un bit asincrono nella rete, che potrebbe creare problemi di vario tipo. In questo modo risparmio anche una NAND perché all'uscita del FF avrò sia P che P negato.

Per quanto riguarda l'oscillatore, direi che anche una frequenza ridicola, pari per esempio a 10kHz, sia più che sufficiente.
Facendo i calcoli per delle porte di tipo HCT, la frequenza ottenuta da un oscillatore a singola porta NAND è
.
Scegliendo un condensatore di capacità pari a 10nF (la capacità di ingresso della porta è dell'ordine delle decine di pF, quindi 10nF va bene) devo impiegare quindi un resistore di resistenza pari a circa. Con questi valori ottengo f=9259Hz circa. Direi che va benissimo.
La stessa formula mi permette anche di progettare il circuito antirimbalzo, scrivendola come:
.
Ipotizzando un tempo di rimbalzo per il tasto di 30ms ottengo e . In serie al pulsante metterò una resistenza pari a , in modo da contenere la corrente di chiusura del tasto e garantire che il condensatore non si scarichi di colpo, cosa che potrebbe dare qualche commutazione non desiderata.

Non resta che mettere tutte le cose insieme e disegnare quindi lo schema elettrico:

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Ecco come viene progettata una macchina a stati (FSM) a livello professionale.
Chiaramente la complicazione della logica, rispetto a una macchina asincrona, ne risente.
Per la verità, in questo caso, nemmeno più di tanto, avendo impiegato solo tre integrati.
Macchine sincrone più complesse vengono oggi implementate su FPGA o microcontrollori, dove i problemi relativi al contenimento del numero di FF o di porte logiche sono infinitamente meno sentiti.

Con questo è tutto.

Pietro.

PS: YAHHHWM... maledetta insonnia...è colpa sua se mi metto a scrivere 'ste robe

[rusty]

PietroBaima te non stai bene eh!
Ti metti a fare gli esercizi del primo anno di Calcolatori Elettronici alle 2 del mattino... forse domani riesco a farlo ancora piu' complicato, aspetta eh, ti piazzo sto bell'automa in una CPLD XC9536 descritta in Verilog

[claudiocedrone]

Fate benissimo a fare queste cose a qualsiasi ora le postiate poiché io non ci capisco una mazza ma per gli studenti del campo esempi simili, a mio parere, sono davvero molto utili.

[ricello9]

In attesa del trigger, prova a fare questa prova veloce.
Stai attento alle connessioni, ti ho numerato i piedini del '175 cosi' non puoi sbagliare.

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Ciao Rusty, ho provato il tuo circuito e FUNZIONA!
Correggimi se sbaglio:
all'accensione il led è spento perché anche se ho il livello logico alto sull'ingresso D l'integrato non sente nessun fronte di salita sul pin di clock e di conseguenza non mi abilita l'uscita; la resistenza da 10k ha la funzione di tenere a livello logico basso il pin ck e di scaricare il condensatore una volta rilasciato il pulsante.
Una volta premuto il pulsante tramite la resistenza da 330 e il condensatore da 10u ho una fronte di salita sul pin di clok e in contemporanea ho un filtro per i rimbalzi causati dalla pressione del pulsante.
Sentito il segnale di clock l'uscita q va a livello alto accendendo il led metre la q negata va a livello basso come di conseguenza anche l'ingresso D; così alla prossima pressione del tasto il led si spegne.
Sono molto distante dal capire il funzionamento?

Grazie per l'aiuto.

[rusty]

Esatto, funziona bene o male cosi'.
Per l'antirimbalzo anche, ma dipende molto dai valori che usi per C e le R associate ai fronti, li ho scelti "larghi" di modo da non avere problemi.

Certo che funziona, non è il modo piu' ortodosso di farlo, ma funziona
Ora pero' monta quello di PietroBaima, altrimenti si offende eh!


E' stato un piacere, ciao

[obiuan]

Che ne dite di progettare la stessa macchina in sincrono?

[...]

Con questo è tutto.

Pietro.

PS: YAHHHWM... maledetta insonnia...è colpa sua se mi metto a scrivere 'ste robe

Bellissimo Pietro, complimenti! (e spiacente per l'insonnia :P)